信号完整性SI是指信号在传输路径上的质量。良好的信号完整性指当在需要的时候，具有所必需达到的电压电平数值。差的信号完整性不是由某一单一因素导致的，而是系统设计中多种因素共同引起的。 当前，由于芯片加工工艺的发展，信号边沿速率越来越快，信号完整性问题开始明显增加，尤其在高速率条件下。
现在的高速数字系统的时钟频率可能高达数百兆Hz，其快斜率瞬变和*高的工作频率，以及很大的电路密集度，必将使得系统表现出与低速设计截然不同的行为，出现了信号完整性问题。破坏了信号完整性将直接导致信号失真、定时错误，以及产生不正确数据、地址和控制信号，从而造成系统误工作甚至导致系统崩溃。因此，信号完整性问题已经越来越引起高速数字电路设计人员的关注。 信号完整性分析的目的就是用*小的成本， *快的时间使产品达到波形完整性、 时序完整性、 电源完整性的要求。
测试能帮我们做什么？
1.验证
– 验证模型的准确性
– 验证仿真结果和实测结果的一致性： 波形， 时序， 电源
– 验证我们的信号质量是否达到设计要求： 波形， 时序， 电源
– 验证我们的硬件设计是否符合设计要求
2.调试
– 问题是否是布局布线的问题：拓扑？端接？ 阻抗？ 走线长度？ 串扰？
– 问题是否是器件的原因：驱动能力？模型？
– 问题是否是硬件设计的问题？
– 调试的目的： 发现问题， 解决问题
信号完整性测试内容
– 误码率的测试
– 均衡和预加重
– Ｓ参数或ＳＰＩＣＥ模型的建模工作
– 电源完整性的测试
– 时序的测试
– 波形的测试
– 阻抗的测试
– 测试对于信号完整性设计的重要性
相关测试标准
企标
ISO 20860-2
IEC 60169-1-1
IEC 60169.1
GJB 681-35-94S
GB/T 11313.15
GB/T 11313.2
GB/T 11313.1
ECA-EIA364-109
ECA-EIA364-108
ECA-EIA364-107
ECA-EIA364-103
ECA-EIA364-102
ECA-EIA364-101
普通会员
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